基于低抖动锁相环的高精度延时电路设计

来源 :第十九届计算机工程与工艺年会暨第五届微处理器技术论坛 | 被引量 : 0次 | 上传用户:dgqshwf
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  本文在130nm CMOS工艺下提出了一款具有高精度延时单元的延时电路。所提出的电路通过锁相环技术与可编程延时技术,与传统延时电路相比,所提出的延时电路误差低于5%,具有更高的延时精度,同时可以实现延时单元延时与工艺制程、电压和温度(以下简称PVT)无关。在后端物理设计中,本电路可以应用于时钟同步、定时恢复等电路。
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