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一种高速滤波器结构的硬件实现
一种高速滤波器结构的硬件实现
来源 :全国第三届DSP应用技术、第九届信号与信息处理联合学术会议 | 被引量 : 0次 | 上传用户:blueeyes
【摘 要】
:
本文提出了一种新型的基于流水线的高速滤波器算法硬件结构,该结构由多个独立宏单元组成,并由一个时序控制器统一控制.在每个宏单元运算中运用了一种改进型的并行算法--Booth
【作 者】
:
文开霞
李哲英
【机 构】
:
北京交通大学,北京,100044
【出 处】
:
全国第三届DSP应用技术、第九届信号与信息处理联合学术会议
【发表日期】
:
2005年期
【关键词】
:
滤波器结构
宏单元
硬件结构
并行算法
时序控制器
高速滤波器
语言实现
统一控制
高速处理
流水线
改进型
组成
运用
运算
信号
设计
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本文提出了一种新型的基于流水线的高速滤波器算法硬件结构,该结构由多个独立宏单元组成,并由一个时序控制器统一控制.在每个宏单元运算中运用了一种改进型的并行算法--Booth算法,从而实现信号的高速处理.本文用VHDL语言实现了单个宏单元的功能,并设计了硬件结构,使其能够在FPGA中实现.
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