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基于快速迭代短卷积算法(ISCA)，实现了一种多级级联结构的新型并行FIR滤波器，在增加一定量的加法器和延迟单元等弱运算强度单元的情况下，大大减少使用的乘法器数量。对于规模越大的并行FIR，采用这种新型结构可节省越多的乘法器数量，使得该结构的并行FIR滤波器更加适合VLSI实现。
基于ISCA算法的多级级联结构并行FIR滤波器
【摘 要】
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基于快速迭代短卷积算法(ISCA)，实现了一种多级级联结构的新型并行FIR滤波器，在增加一定量的加法器和延迟单元等弱运算强度单元的情况下，大大减少使用的乘法器数量。对于规模越
【机 构】
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中国电子科技集团第五十八研究所,江苏 无锡 214035
【出 处】
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中国电子学会第十三届青年学术年会
【发表日期】
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2007年期
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