【摘 要】
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Viterbi decoding has been widely used in many communication systems. Due to the large computa-tion complexity, it is usually implemented with ASIC chips, FP
【机 构】
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State Key Laboratory of Rail Traffic Control and Safety,Beijing Jiaotong University, Beijing, China
【出 处】
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2011年青年通信国际会议(ICYC2011)
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Viterbi decoding has been widely used in many communication systems. Due to the large computa-tion complexity, it is usually implemented with ASIC chips, FPGA, or optimized hardware. However, in soft-ware radio, Viterbi decoder becomes the bottleneck of whole system, especially in wideband communicationsystems which require high throughput decoding. Multi-core CPU based software radio system becomes popu-lar and shows great performance in wideband communication systems. A high performance Viterbi decoderdesign for IEEE 802.11a/g/n on multi-core CPU architecture is presented. By using parallel processing tech-niques, the decoding throughput for different convolution codes 1/2, 2/3 and 3/4 achieves up to 115Mbps,120Mbps and 128Mbps, respectively.
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