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本文介绍了怎样在嵌入式CPU 80C186XL DRAM刷新控制单元的基础上,利用CPLD技术和80C186XL的时序特征设计一个低价格,功能完整的DRAM控制器的设计方法,并采用VHDL语言编程实现.
80C186XL嵌入式系统中DRAM控制器的CPLD解决方案
【摘 要】
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本文介绍了怎样在嵌入式CPU 80C186XL DRAM刷新控制单元的基础上,利用CPLD技术和80C186XL的时序特征设计一个低价格,功能完整的DRAM控制器的设计方法,并采用VHDL语言编程实现
【机 构】
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湖南计算机股份有限公司(长沙)
【出 处】
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第七届计算机工程与工艺学术年会
【发表日期】
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2001年期
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