【摘 要】
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本文基于FPGA实现了分组马尔科夫叠加哈达玛变换码(BMST-HT)的编译码系统.BMST-HT码是一种新提出的固定长度、码率可变的码.在编码器中我们增加额外存储块来缓存同步数据，使得数据无需等待同步.译码器的基本计算单元结合量化步长使用带有补偿值的MAX*算法，用计算的方式求得补偿，节省查找表所消耗的面积.并且我们还使用了两路并行软输入软输出(SISO)算法以及滑窗译码算法来提升译码速度.最终的
【机 构】
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中山大学电子与通信工程系,广东省广州市,中国
【出 处】
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第二十二届中国电子学会信息论学术年会
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本文基于FPGA实现了分组马尔科夫叠加哈达玛变换码(BMST-HT)的编译码系统.BMST-HT码是一种新提出的固定长度、码率可变的码.在编码器中我们增加额外存储块来缓存同步数据，使得数据无需等待同步.译码器的基本计算单元结合量化步长使用带有补偿值的MAX*算法，用计算的方式求得补偿，节省查找表所消耗的面积.并且我们还使用了两路并行软输入软输出(SISO)算法以及滑窗译码算法来提升译码速度.最终的BMST-HT系统在离香农限在1dB以内达到了10-5的误比特率，编译码速率在不同码率下有不同表现.
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