【摘 要】
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本文研究了数字ASIC芯片设计中的逻辑综合理论、静态时序分析理论、电源网络分析和设计理论、时钟树的设计与综合理论、布局布线理论等关键技术,并在这些关键理论技术的基础
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本文研究了数字ASIC芯片设计中的逻辑综合理论、静态时序分析理论、电源网络分析和设计理论、时钟树的设计与综合理论、布局布线理论等关键技术,并在这些关键理论技术的基础上很好地完成了一个750万门的雷达数字信号处理SoC芯片的后端工作,已从SMIC(中芯国际)流片完成,并封装完毕,该芯片的系统测试工作正在进行中,绝大部分的功能已经验证正确。该芯片是采用SMIC0.18um1P6M工艺、自主开发的、内嵌DSP核的通用雷达信号处理SoC(片上系统)芯片,流片面积11.744mm×11.744mm,封装后面积31mm×31mm。其后端工作主要包括:逻辑综合、静态时序分析、电源分配网络的设计、时钟树的设计与综合、布局布线等。本文的主要内容如下:1.深亚微米高性能ASIC芯片的逻辑综合理论分析和雷达数字信号处理SoC芯片的逻辑综合过程2.深亚微米高性能ASIC芯片的静态时序分析理论分析和雷达数字信号处理SoC芯片的静态时序分析过程3.深亚微米高性能ASIC芯片的电源分配网络的分析与设计和雷达数字信号处理SoC芯片的电源分配网络的设计概要4.深亚微米高性能ASIC芯片的时钟树的设计与综合和雷达数字信号处理SoC芯片的时钟树设计5.深亚微米高性能ASIC芯片的布局布线和雷达数字信号处理SoC芯片的布局布线
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