基于FPGA的罗兰C路基导航系统RS编译码器的设计与实现

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罗兰-C路基导航系统主要应用于军事领域,其信息在信道传输的可靠性是一项迫切需要解决的问题,而RS码纠错能力极强,已被广泛应用于存储介质、通信、计算机、数字电视和网络等领域。根据ITU-R M589.3建议,RS(30,10)码是罗兰-C路基导航系统PPM通信信道上采用的标准码,同时根据罗兰-C路基导航系统通信信道的特点,本文基于FPGA设计并实现了一个满足罗兰C系统要求的RS编译码器,其所有运算都是基于有限域GF(27)上进行的。本文主要内容如下:1.综述了罗兰C系统、RS编译码器以及FPGA的研究现状及意义。2.有限域上,除法运算等效为乘法运算,本文提出了有限域上乘法器的设计,并对有限域乘法器进行了两级优化,优化后的乘法器很大程度的提高了编码的效率,减少了硬件资源。3.进行了RS(30,10)一般编码器的设计。针对一般编码器存在不能连续编码的问题,对其进行改进,设计实现了一个连续编码器,从而满足Loran-C路基导航系统的实时性要求。4.进行了RS(30,10)译码器的设计。包含了伴随式、BMA、Forney以及钱搜索模块,采用顶层模块对其封装,完成了一个完整译码器的设计,并将译码器仿真结果与Matlab软件调用其ip核解码函数的结果相比较,验证了所设计的译码器的正确性。5.将改进的连续编码器和译码器进行RTL仿真。所使用的开发工具是QuartusⅡ、ISE9.1和Modelsim仿真平台,用Verilog语言编写代码,在Modelsim中建立相应的测试激励,与用Matlab实现的RS编译码输出结果进行对比,证明了连续编码器以及译码器功能设计的正确性。本文设计的RS编译码器可移植性很强,经过一些修改便可运用到其它的通信信道中,具有一定的应用价值。
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