【摘 要】
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数模转换器(DAC)是现代数字和模拟电路中用途广泛的重要接口部件。随着计算机、数字信号处理、通信等技术的发展，DAC成为了提高信号处理速度和精度的关键。这些对DAC的精度和
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数模转换器(DAC)是现代数字和模拟电路中用途广泛的重要接口部件。随着计算机、数字信号处理、通信等技术的发展，DAC成为了提高信号处理速度和精度的关键。这些对DAC的精度和速度提出了更高的要求。在高速高精度DAC设计中，高速译码器是整个DAC设计的难点和瓶颈之一。论文设计了一种用于高速高精度DAC的高速流水线低逻辑复杂度DEM译码电路，能有效地减少高速DAC中信号变换的非线性误差。论文以14位DAC为例来说明这种译码方式的结构特点。14位输入采用5+5+4的分段混合译码方式，其中高五位和中五位都采用新型的低逻辑复杂度的DEM译码方式，低四位采用二进制译码方式。论文采用Matlab对14位DEM DAC进行建模和仿真，当输入信号频率为121MHz，采样频率为1GHz时，无杂波动态范围为99.84dB，信噪比为85.94dB，有效位数为13.9位，积分非线性误差为0.522LSB,微分非线性误差为0.259LSB。基于SMIC0.18μm1P6M CMOS工艺，工作电压为1.8V，系统频率为1GHz，DEM译码电路芯片面积为100974μm2。论文所设计的高速流水线低逻辑复杂度DEM译码电路能满足高速高精度DAC设计要求。
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