【摘 要】
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该论文的研究内容是应用于广播电视监测系统的高速数据传输通讯平台的PCI局部总线(Peripheral Component Interconnect Special Interest Group)的Verilog HDL语言的设计与应
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该论文的研究内容是应用于广播电视监测系统的高速数据传输通讯平台的PCI局部总线(Peripheral Component Interconnect Special Interest Group)的Verilog HDL语言的设计与应用.该论文的研究目的是为了解决广播电视监测系统对大量数据高速传输与目前串行口的低速数据接口之间产生的性能瓶颈.在设计过程中,主要应用了Verilog HDL硬件描述语言,根据广播电视监测系统对数据传输的需求确定了通讯平台与广播电视监测系统之间的总线方案及支持PCI总线的协议内容.采用Verilog HDL模块化设计思想,将PCI接口通讯平台的设计划分为几个相互关联的模块,首先实现了该通讯平台的从PCI部分,并与按照功能的要求和内外通讯协议的内容,根据verilog HDL语言的自上而下的设计方法,讨论了各模块的外部特性,算法描述.并以状态机的设计与实现为核心,通过状态机各状态的定义数据传输和安全性设计、状态转移、RTL描述等,完成了数据传输进程中的数据通道和关键控制信号的设计.
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