【摘 要】
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本文针对采样频率为400M/s并行多路高速数据采集系统中的噪声及干扰问题,采用自上而下模块化的设计方法,设计了一个基于FPGA和分布式算法的32阶系数可调数字滤波器,并对该数
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本文针对采样频率为400M/s并行多路高速数据采集系统中的噪声及干扰问题,采用自上而下模块化的设计方法,设计了一个基于FPGA和分布式算法的32阶系数可调数字滤波器,并对该数字滤波器进行了具体的实现和仿真。研究工作主要包括以下几个方面：(1)以数字滤波器的基本理论为依据,利用MATLAB的FDA Tools工具箱设计数字滤波器的滤波器系数,并对其进行量化处理。(2)采用基于RAM查找表的分布式算法,实现了针对并行多路高速数据采集系统的32阶系数可调数字滤波器的总体设计。(3)在Quartus Ⅱ8.1环境下,运用VHDL语言和图形化设计相结合的方式,分模块实现了该32阶系数可调数字滤波器,并以一个45M-55M带通数字滤波器为例对该数字滤波器进行了仿真。
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