基于ARM ESL平台的H.264编码器硬件加速设计和研究

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随着H.264视频压缩技术越来越广泛的应用,关于H.264的研究也越来越多,其中一个主要的目标就是如何在保证视频图像质量不受影响的前提下有效的提升编解码的速度。目前国际国内对H.264解码器的ASIC设计比较成功,相对而言,编码器的复杂度更高。编码器的ASIC设计研究较为复杂,目前国际国内也都在研究过程当中。所以本次科研项目,旨在找出一种合理的软硬件划分方法,通过分析软件代码的时间代价,分析出其中处于底层、耗时久、软硬件易分离、计算量大、硬件易实现、并行度高、硬件开销较小的部分模块,然后通过软硬件划分软件在系统级仿真平台(ESL)上检验这种软硬件协同工作的功能和效果,进而进行硬件并行度分析,实验表明,划分出来的模块可以在保证功能完全正确,编码质量不受影响的情况下将编码器的运行时间节省约30%左右,有效的加速了编码器的运行速度,是一种较为合理的硬件加速方法。
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