【摘 要】
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本文描述了几种常用的高速CMOS A/D转换器的原理和结构，分析了流水线型的A/D转换器的各种误差源，并提出合适的校正技术。最后，采用流水线结构及其校正技术，设计出一种分辨率为10b
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本文描述了几种常用的高速CMOS A/D转换器的原理和结构，分析了流水线型的A/D转换器的各种误差源，并提出合适的校正技术。最后，采用流水线结构及其校正技术，设计出一种分辨率为10bit，采样频率为50MHZ的高速CMOS模数转换器。
本转换器采用每级1.5bit的结构，降低了对比较器失调的要求。而比较器，采用了一种没有预放大器的动态比较器，它不消耗静态功耗，从而大大降低了整个系统的功耗。在采样保持电路的开关电容电路，采用了消除系统失调的结构，降低了误差。运放设计用折叠式共源共栅级结构代替了传统的带有辅助放大器的运放，既达到了很高的DC增益和单位增益带宽（GBW），又保持了较宽的输出摆幅，同时减小了芯片的面积。
本设计使用0.35微米工艺，3.3V工作电压。利用CADENCE或HPSPICE对所设计的电路进行仿真，得到系统的静态和动态特性，证明系统达到了预期的效果。
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