【摘 要】
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随着电路系统数字化程度的不断提高,尤其是片上系统(SOC)的快速发展,作为连接模拟信号与数字信号的桥梁的高性能模数转换器的需求日益增强。与其它结构相比,流水线ADC因其在
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随着电路系统数字化程度的不断提高,尤其是片上系统(SOC)的快速发展,作为连接模拟信号与数字信号的桥梁的高性能模数转换器的需求日益增强。与其它结构相比,流水线ADC因其在高精度、高速度与低功耗之间拥有良好的折中而备受青睐。本文采用韩国东部半导体dongbu013工艺,设计研究了一个50MSample/s的12位的流水线ADC。在查阅大量文献的前提下,本文根据模拟IC设计流程,以高速、低压、低功耗为目标,逐步完成了各个模块电路以及整体电路的设计。主要工作包括:(1)完成两相不交叠时钟电路的设计;自举开关电路(为消除开关电荷注入误差)设计;为保证开关电容电路的速度和精度设计了增益增强型折叠共源共栅运算放大器;动态锁存比较器电路设计。(2)由单元电路完成各个子模块电路的设计,并对各个模块和整体系统进行详细仿真。(3)为降低功耗采用电容和运算放大器逐级递减技术,为克服比较器失调误差设计了数字校正电路。本设计在Cadence工作平台下,使用Spectre仿真器进行模拟验证。模拟仿真结果表明,在+1.2V电源电压下,ADC的模拟信号输入范围为0.4V～0.8V,分辨率为12位,采样速率达50MHz,功耗约为84mW。该流水线ADC的性能指标达到了设计要求。
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