【摘 要】
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本文论述了0.18um下一块数字电视芯片的物理设计过程。该芯片是数字电视接收信道的基带解调模块，用于将中频数字信号转化为MPEG2码流输出。芯片规模达到200万门，包含72个Memory
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本文论述了0.18um下一块数字电视芯片的物理设计过程。该芯片是数字电视接收信道的基带解调模块，用于将中频数字信号转化为MPEG2码流输出。芯片规模达到200万门，包含72个MemoryIP，共6个工作时钟，最高频率为60.8MHz。在重点讲述该芯片物理设计流程中布局规划、功耗规划、时序驱动的流程、时钟树综合、可测试性设计等步骤的同时，突出了针对DSM下诸多问题的解决方案。然后讲述了芯片所采用的验证方法，如动态功能验证、静态时序验证、功耗完整性验证、信号完整性验证等。
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