基于高性能嵌入式处理器的H.264编码协处理器设计

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随着设计工具、IP(Intellectual Property)核、设计方法学的发展,ESL设计方法越来越受重视。该设计方法利用已有的IP核,以系统级的设计和验证作为设计的起点,为以后的硬件设计提供参照模型。本文以ESL平台为载体,通过分析X.264开源编码器软件代码的时间代价,将其中处于底层、耗时久、计算量大、硬件易于实现、并行度高的部分用协处理器实现。设计了专用的协处理器指令集,包括去块效应滤波、DCT/IDCT变换、运动估计及运动补偿的部分算法。之后在系统平台下对设计进行了功能和性能的验证,并对实现后的系统性能提升进行了分析。实验表明,使用协处理器模块可以在保证功能完全正确,编码质量不受影响的情况下将编码器的运行时间节省50%以上,有效的加速了编码器的运行速度,是一种较为成功的硬件设计加速方法。
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