MIMO-GMC链路仿真与编译码模块的硬件实现

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近几年来,移动通信在全球范围内发展迅速,第三代移动通信系统逐渐进入商用,但仍不能满足移动用户日益增长的需要。下一代无线移动通信的目标是支持高质量高速率的移动多媒体业务。东南大学移动通信国家重点实验室根据863 FuTURE研究计划,提出MIMO-GMC系统,以实现峰值传输速率不低于100 Mbps的高效分组数据传输。基于这种系统方案,本论文主要进行了三部分的工作:MIMO-GMC链路仿真,Turbo-RS级联码研究和RS码的FPGA硬件实现。论文首先研究了MIMO-GMC系统的物理层算法,并采用C语言完成单载波和多载波系统链路程序,在VC++环境中对链路进行仿真,以评估链路在不同移动速度、信道环境下传输不同速率数据的性能及系统内部结构对性能的影响。论文着重对系统中以RS码为外码、Turbo码为内码的级联码编译码技术进行了研究,对两种码的编译码算法和级联方法进行了探讨和C语言仿真,给出了完全迭代的Turbo-RS级联码的迭代时延、性能分析及仿真结果,并仿真了级联码对MIMO-GMC系统的性能影响。对于级联码中的RS码,论文用Verilog HDL语言在FPGA上实现了RS码编译码器。其中译码器采用修正的欧几里德算法(MEA),并在实现中使用一种新的伽罗华域乘法器,从而降低了RS码编译码硬件实现的复杂度。在ISE集成开发环境下,使用ModelSim、Synplify等EDA工具软件,完成了硬件描述语言级仿真、综合及FPGA实现的性能测试。最后,在Xilinx Virtex-II Pro 70芯片上进行了在线调试,并通过测试。
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