【摘 要】
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verilog是当前应用最为广泛的硬件设计语言之一，它可以用于硬件系统各种级别的设计、综合、仿真。PSL是一种标准的描述硬件和嵌入式系统规范的语言(IEEE-1850)。PSL的简单子集
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verilog是当前应用最为广泛的硬件设计语言之一，它可以用于硬件系统各种级别的设计、综合、仿真。PSL是一种标准的描述硬件和嵌入式系统规范的语言(IEEE-1850)。PSL的简单子集PSLS是指满足单调时序步进的PSL语言子集，较易被模拟仿真。本文主要研究了基于PSL断言的verilog仿真算法和实现技术。
本文首先研究了作用在有限长字符串上的PSL公式满足强度，然后分别对PSL强满足、弱满足和强违背提出了在有限字符串上的组合定律，由此本文定义了检测PSL公式强满足、未决和强违背的条件。本文使用自动机作为PSL动态验证器的验证引擎。虽然交替式自动机(AFA)在表示线性时态逻辑时具有线性空间复杂度，但是PSL是带循环的ω语言，AFA也不支持同步PSL“长度匹配语句”的所有分支，所以本文提出了局部变量增强的交替式自动机(LAFA)，解决分支同步和循环计数的问题。
本文也重点讨论了基于断言的仿真器实现方法。使用有向无环图表示LAFA的运行轨迹，并用符号化的方法编码状态和局部变量。该编码方式允许对状态和局部变量多重赋值，状态的不同值代表LAFA不同的执行结果。通过以上方法，能够维持验证在时间和空间上的线性复杂度。
本文最后考察了verilog仿真参考模型，在开源项目Icarus verilog和GTKwave的基础上开发了PSL-verilog动态验证器原型，并给出了一个完整的实例。
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