低码率的QC-LDPC码编译码算法与FPGA实现

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QC-LDPC(Quasi-Cyclic Low-Density Parity-Check,准循环LDPC)码具有译码复杂度低、错误平层低等诸多优点,使其在信息可靠传输中具有良好的应用前景。结合现有的理论成果和实践经验,设计性能优良且编译码复杂度低的QC-LDPC码是近年来人们研究的热点问题。   本文结合工程实践项目,对QC-LDPC码的编译码算法和硬件实现中的几个关键问题进行了深入的研究,主要完成了以下几方面的工作:   1.系统的总结了LDPC码的发展历程及基本概念和编译码原理,重点介绍了BP(BeliefPropagation,置信传播)译码算法和最小和译码算法,并对两种译码算法的性能进行了比较,简要介绍了QC-LDPC码的特性。   2.针对QC-LDPC码给出了无四环的构造方法,提出了对矩阵进一步修饰时要遵循的原则。   3.基于编码原理设计了适合低码率QC-LDPC码的编码器,加快了编码过程和减小了编码复杂度。   4.基于归一化最小和算法的泛洪迭代机制,给出了适合于硬件实现且结构简单的低码率QC-LDPC的译码算法。并提出了进一步减小译码时延的方法。
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