【摘 要】
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本文按照top-down的现代IC设计方法介绍了一种双精度浮点乘法器的设计方案和电路设计.由于实现尾数相乘的定点乘法器和对尾数的正确舍入是影响浮点乘法器性能的关键,所以本文
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本文按照top-down的现代IC设计方法介绍了一种双精度浮点乘法器的设计方案和电路设计.由于实现尾数相乘的定点乘法器和对尾数的正确舍入是影响浮点乘法器性能的关键,所以本文重点对这两个方面进行优化设计.在尾数相乘部分,采用改进的符号选择Booth编码方法产生部分积,然后用改进的4:2压缩器对部分积进行压缩.这样一方面缩短了关键路径上的时延,另一方面节省了硬件量.另外为了提高时钟频率,该乘法器应用了流水线技术把乘法过程分解到两个周期内完成.在舍入部分,通过采用插值舍入法一方面对舍入进行逻辑化简,另一方面对处于关键路径上的舍入信息位的产生电路和复合加法器的电路进行精心设计,使关键路径得到缩短,舍入速度得到提高,从而也就提高了整个浮点乘法器的速度.
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