【摘 要】
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分组密码是商业密码体制的主流密码.它具有速度快、易于标准化和便于软硬件实现等特点.因此分组密码在计算机通信和信息系统安全领域中具有广泛的应用.随着计算机技术的飞速
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分组密码是商业密码体制的主流密码.它具有速度快、易于标准化和便于软硬件实现等特点.因此分组密码在计算机通信和信息系统安全领域中具有广泛的应用.随着计算机技术的飞速发展,原有的数据加密标准(DES)已不能满足各方面对保密的要求,美国颁布了新的高级数据加密标准(AES).今后,高级数据加密标准(AES)将替代DES成为新的国际数据加密标准.该文的研究开发工作受到国家863计划项目(商业密码芯片的安全结构和技术研究)的支持.该文分析了高级加密标准算法的原理,并在此基础上针对硬件设计的特点和对速度的要求,对AES的硬件实现方法进行研究,并用硬件设计语言(Verilog HDL)描述了该算法的基本过程和结构,完成了密钥长度为128比特的AES的加/解密FPGA设计.通过计算机仿真表明,在时钟频率为25MHZ的条件下,加/解密速度是3.2Gbits/s,达到预期的设计要求.
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