【摘 要】
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随着EDA技术的发展,使得系统的设计具有周期短、可靠性强、体积小、功耗小、调试维修简单等优点.以往的故障录波器是基于16位单片机硬件平台,速度慢,数字信号处理能力不强,精
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随着EDA技术的发展,使得系统的设计具有周期短、可靠性强、体积小、功耗小、调试维修简单等优点.以往的故障录波器是基于16位单片机硬件平台,速度慢,数字信号处理能力不强,精度不高.作者参与了发变组故障录波器的开发,完成了基于CPLD/FPGA+DSP硬件平台的采样系统主板的EDA设计.CPLD/EPGA+DSP硬件平台能够满足控制灵活与数据处理能力强的设计要求.在设计中使用CPLD/FPGA实现了对输入信号频率的跟踪锁定和倍频,控制AD采样,控制FIFO、FLASH、SRAM的操作,控制双口RAM和ISA与后台机进行通信,同时还提出了一种基于CPLD/FPGA实现Watchdog的设计方法.另外,为了解决大容量数据存储的问题,作者用CPLD/FPGA设计了SDRAM与DSP的接口.论文还结合数字信号处理(DSP)理论进行了实际的仿真.分别使用MATLAB和DSP汇编语言的开发调试软件—Code Composer实现了FIR数字滤波,并对经过仿真所得到的数据和时序图进行了分析、比较.
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