【摘 要】
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传统的实时信号处理系统大多采用DSP+MCU结构,即由DSP完成对图像、视频等数字信号的处理,MCU完成对外围设计的控制,从而完成实时信号处理系统的设计。现代的许多通信、视频和
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传统的实时信号处理系统大多采用DSP+MCU结构,即由DSP完成对图像、视频等数字信号的处理,MCU完成对外围设计的控制,从而完成实时信号处理系统的设计。现代的许多通信、视频和图像等实时信号处理系统要求很高的实时性,而传统的通用可编程DSP已无法满足其实时性的要求,所以本论文提出了用FPGA卸载DSP算法中计算量大的模块用硬件流的方式实现,主要是算法比对部分。由于FPGA的并行信号处理等特点,提高了算法的处理速度。在本论文中,对用FPGA卸载DSP算法中计算量大的算法比对部分做了整体设计,该设计主要是由9个模块构成。同时,在论文中介绍了整体设计中部分模块的主要实现过程,为了得到最佳的模块设计,论文中对同一模块采用了不同的设计方案。其中,模块设计是用Verilog硬件描述语言实现的,模块编译与仿真是在Altera综合开发平台QuartusII的环境中实现的。
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