【摘 要】
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针对视频系统对时钟多样性的要求,基于DDPS(直接数字周期综合)原理,提出了一种新的电路结构,采用分组交叉寄存控制的方武,对800ps和50ps相位分别进行粗选和细选,加以小数部分
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针对视频系统对时钟多样性的要求,基于DDPS(直接数字周期综合)原理,提出了一种新的电路结构,采用分组交叉寄存控制的方武,对800ps和50ps相位分别进行粗选和细选,加以小数部分累加进位补偿,能够获得相位分辨率50ps,平均周期最大误差0.2ps,综合频率达625MHz的视频时钟输出,改变控制字后在5个时钟周期即可获得综合时钟输出.电路采用SMIC 0.18岫P1M4 Logic 1.8V工艺,面积为0.06mm2,功耗最大约32.8mW,适用于视频处理系统中多时钟产生SoC芯片.
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