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用VHDL语言在CPLD/FPGA上实现浮点运算
用VHDL语言在CPLD/FPGA上实现浮点运算
来源 :暨南大学学报:自然科学与医学版 | 被引量 : 0次 | 上传用户:AJGSUN
【摘 要】
:
介绍了用VHDL语言在硬件芯片上实现浮点加/减法、浮点乘法运算的方法,并以Altera公司的FLEX10K系列产品为硬件平台,以Maxplus Ⅱ为软件工具,实现了6点实序列浮点加/减法运算和浮点
【作 者】
:
沈明发
易清明
等
【机 构】
:
暨南大学电子工程系
【出 处】
:
暨南大学学报:自然科学与医学版
【发表日期】
:
2002年5期
【关键词】
:
超高速集成电路硬件描述语言
VHDL
浮点运算
复杂可编程逻辑器件
CPLD/FPGA
现场可编程门阵列
数字信号处理
VHDL
float number op
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介绍了用VHDL语言在硬件芯片上实现浮点加/减法、浮点乘法运算的方法,并以Altera公司的FLEX10K系列产品为硬件平台,以Maxplus Ⅱ为软件工具,实现了6点实序列浮点加/减法运算和浮点乘法运算。
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