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提出了一种适用于突发通信的FPGA的定时同步的实现方法,分析了系统每个模块的作用,给出每个模块的硬件实现方法。最后在QuartusⅡ9.0编写VHDL代码和测试激励,并用signaltap对定时恢复算法进行仿真验证,结果表明,这种算法时钟抖动小,定时精度高。
突发通信定时同步算法的FPGA实现
【摘 要】
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提出了一种适用于突发通信的FPGA的定时同步的实现方法,分析了系统每个模块的作用,给出每个模块的硬件实现方法。最后在QuartusⅡ9.0编写VHDL代码和测试激励,并用signaltap对
【机 构】
：
中国电子科技集团公司第五十四研究所
【出 处】
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科技信息
【发表日期】
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2013年21期
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