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给出了一种基于FPGA的切实可行的卷积码Viterbi译码器的实现方案。该方案只需要很少的硬件资源,速度较快。可以很方便地和Turbo译码器结合在单片的FPGA上,并应用于3GPPWCDMA移动通信系统中。
卷积码Viterbi译码器的FPGA的设计与实现
【摘 要】
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给出了一种基于FPGA的切实可行的卷积码Viterbi译码器的实现方案。该方案只需要很少的硬件资源,速度较快。可以很方便地和Turbo译码器结合在单片的FPGA上,并应用于3GPPWCDMA
【机 构】
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解放军信息工程大学信息工程学院
【出 处】
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通信技术
【发表日期】
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2003年03期
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