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RS码并行编码器的设计实现
RS码并行编码器的设计实现
来源 :信息技术 | 被引量 : 1次 | 上传用户:hlwang72
【摘 要】
:
RS码是一类具有很强纠错能力的多进制BCH码,也是一类典型的代数几何码。文中分析了GF(2)8域上的RS(255,223)码编码器的基本原理,并在Xilinx Xc6vsx315t FPGA上设计实现了RS(255,223)高速并行编码器。
【作 者】
:
李双焕
【机 构】
:
中国科学院电子学研究所
【出 处】
:
信息技术
【发表日期】
:
2015年02期
【关键词】
:
RS码
编码器
高速并行
RS code
encoder
high-speed parallel
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RS码是一类具有很强纠错能力的多进制BCH码,也是一类典型的代数几何码。文中分析了GF(2)8域上的RS(255,223)码编码器的基本原理,并在Xilinx Xc6vsx315t FPGA上设计实现了RS(255,223)高速并行编码器。
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