【摘 要】
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研究了一种采用FPGA+双DSP的航片高速并行处理系统,并用区域分解算法对航片处理任务进行划分与分配.FPGA实现对航片预处理.DSP实现航片高层处理.DSP部分由双TMS320C6201芯片
【机 构】
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华中科技大学图像识别与人工智能研究所
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研究了一种采用FPGA+双DSP的航片高速并行处理系统,并用区域分解算法对航片处理任务进行划分与分配.FPGA实现对航片预处理.DSP实现航片高层处理.DSP部分由双TMS320C6201芯片构成高速运算处理单元,峰值处理能力每s可达3.2×109条指令.FPGA和DSP具有各自的存储器.在系统中应用符合数字图像处理特点的区域分解并行算法,这样使在空间域串行图像处理算法得到并行化,从而合理地对任务进行划分与分配,同时保证各DSP处理机负载平衡.该方法适合多种图像处理算法,实现简单,大大减少了开发
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