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文中简述了一种基于CPLD的多功能数字钟的设计方案。所有电路都固化在一片CPLD芯片中,电路结构简单、控制方便,资源利用率高,成本低,调试比较容易。采用VHDL和原理图相结合的设计输入方式,在MAXPLUS II开发环境下完成设计、编译和仿真。
基于CPLD的多功能数字钟的设计
【摘 要】
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文中简述了一种基于CPLD的多功能数字钟的设计方案。所有电路都固化在一片CPLD芯片中,电路结构简单、控制方便,资源利用率高,成本低,调试比较容易。采用VHDL和原理图相结合的
【机 构】
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西北师范大学知行学院计算机与电子信息工程系
【出 处】
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仪器仪表用户
【发表日期】
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2016年03期
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