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为了缩短系统开发周期,提高系统开发效率,本文提出了一种基于FPGA的数字秒表设计方法.该设计以MaxplusⅡ为开发工具,以VHDL为硬件描述语言,实现了秒表的计时、复位和启停等功能.
基于FPGA的数字秒表的设计
【摘 要】
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为了缩短系统开发周期,提高系统开发效率,本文提出了一种基于FPGA的数字秒表设计方法.该设计以MaxplusⅡ为开发工具,以VHDL为硬件描述语言,实现了秒表的计时、复位和启停等功
【机 构】
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唐山学院计算机系,唐山学院信息工程系
【出 处】
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网络与信息
【发表日期】
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2004年期
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