时域Reed-So1omon译码器及其在FPGA上的实现

来源 :南京邮电学院学报(自然科学版) | 被引量 : 0次 | 上传用户：huang_hh

【摘要】

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基于Blahut提出的RS(Reed-Solonion)码时域译码算法,提出了一种时域RS译码器,详细讨论了 FPGA(现场可编程门阵列)实现该译码器的过程,并以六进制RS(63,47)码为例对用FFGA实现

【作者】

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单方骥张力军

【机构】

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南京邮电学院通信工程系,

【出处】

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南京邮电学院学报(自然科学版)

【发表日期】

：

2001年3期

【关键词】

：

Reed-Solomon码时域译码现场可编程门阵列

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基于Blahut提出的RS(Reed-Solonion)码时域译码算法,提出了一种时域RS译码器,详细讨论了 FPGA(现场可编程门阵列)实现该译码器的过程,并以六进制RS(63,47)码为例对用FFGA实现的 RS译码器性能进行了分析,该译码器输入码流速率可达6 Mbit/s,占用的FPGA(SpartanⅡ系列)的资源不到相应频域译码器的一半.

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