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小波变换的应用越来越广泛,但小波变换的硬件实现成为小波变换实时应用的一个关键问题。根据提升小波变换的框架结构,以小波子带系数自适应编码为核心,研究了基于5层5/3提升小波变换及其反变换的ECG信号的压缩算法及其FPGA实现。系统设计采用Verilog HDL语言和流水线设计方法,提高了硬件资源的利用率。系统实现选用Altera公司CYCLONE EP2C35F672C器件,并采用MIT-BIH数据库中的ECG信号进行测试。该心电数据压缩算法在均方误差可控的范围内算法获得了较大的压缩比,并利用设计的硬核实现