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文章设计了一种并行编码的哈夫曼硬件编码器,它采用了流水线和并行编码方法,使得在一个时钟周期内可以编码一个字节的数据,在编码时显著降低了工作频率.文章给出了关键部分的实现方案并分析了实验结果.
并行哈夫曼编码器的硬件设计与实现
【摘 要】
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文章设计了一种并行编码的哈夫曼硬件编码器,它采用了流水线和并行编码方法,使得在一个时钟周期内可以编码一个字节的数据,在编码时显著降低了工作频率.文章给出了关键部分的
【机 构】
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华中科技大学图像信息处理与智能控制教育部重点实验室
【出 处】
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微电子学与计算机
【发表日期】
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2002年10期
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