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乘法器是数字信号处理领域的基本逻辑部件，应用广泛。用Verilog硬件描述语言设计了加法树乘法器、查找表乘法器和Booth乘法器，在Modelsim软件环境下进行了仿真，在QuartusII开发平台上基于Stratix器件对这三种方案进行了综合验证，并对结果进行了分析和比较。
基于FPGA的乘法器设计和实现
【摘 要】
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乘法器是数字信号处理领域的基本逻辑部件，应用广泛。用Verilog硬件描述语言设计了加法树乘法器、查找表乘法器和Booth乘法器，在Modelsim软件环境下进行了仿真，在QuartusII开发
【机 构】
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河南大学物理与电子学院
【出 处】
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河南机电高等专科学校学报
【发表日期】
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2010年2期
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