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提出了基于双比特算法的新型除法器及其VLSI实现结构．与MIPS微处理器中的除法器相比，它的平均执行周期减少了52．5％，而其最大延时几乎不变，仅晶体管数目增加了60％．仿真结果表明，在相同的运算能力下，其功耗仅为MIPS中除法器的11．3％．
基于双比特算法的新型除法器
【摘 要】
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提出了基于双比特算法的新型除法器及其VLSI实现结构．与MIPS微处理器中的除法器相比，它的平均执行周期减少了52．5％，而其最大延时几乎不变，仅晶体管数目增加了60％．仿真结果表明，在相同
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
【出 处】
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半导体学报
【发表日期】
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2004年6期
【基金项目】
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国家高技术研究发展计划资助项目 (编号 :2 0 0 2AA1Z10 60 )~~
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