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基于FPGA的LDPC译码器的设计

来源 :吕梁学院学报 | 被引量 : 0次 | 上传用户：hebehehe

【摘 要】

：

面向较长LDPC码的硬件实现,在FPGA平台上实现了LDPC全并行译码器,实现变量节点功能,校验节点功能,提出了稀疏矩阵存储和FPGA指针操作的实现,并实现数据流的乒乓操作.通过Mode

【作 者】

：

王海龙  郭大波 

【机 构】

：

吕梁学院物理系,山西大学物理电子工程学院

【出 处】

：

吕梁学院学报

【发表日期】

：

2019年2期

【关键词】

：

FPGA 译码器 并行 

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论文部分内容阅读

面向较长LDPC码的硬件实现,在FPGA平台上实现了LDPC全并行译码器,实现变量节点功能,校验节点功能,提出了稀疏矩阵存储和FPGA指针操作的实现,并实现数据流的乒乓操作.通过Modelsim功能仿真表明,在500 MHz的时钟频率下,实现了在迭代最大次数为20次的条件下,译码速率可达240 Mbps.

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