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通过对应用于图象处理的边界增强算法的研究，结合目前世界上流行的硬件描述语言ＶｅｒｉｌｏｇＨＤＬ的设计，将边界增强算法用硬件电路模块的形式来实现。此硬件电路采用流水线结构，关键运算部件采用复用形式，以提高系统处理效率。
边界增强算法的硬件实现
【摘 要】
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通过对应用于图象处理的边界增强算法的研究，结合目前世界上流行的硬件描述语言ＶｅｒｉｌｏｇＨＤＬ的设计，将边界增强算法用硬件电路模块的形式来实现。此硬件电路采用流水线结构，关键运算部件采用复用形式，以提高系统处理效率。
【机 构】
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复旦大学电子工程系
【出 处】
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半导体技术
【发表日期】
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2001年11期
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