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期刊论文
DDS逻辑优化设计及Verilog实现
DDS逻辑优化设计及Verilog实现
来源 :电子设计应用 | 被引量 : 0次 | 上传用户:wucaixia303
【摘 要】
:
本文主要介绍了在DDS系统中,为了提高芯片运算速度,加大输出带宽,减小芯片规模从而提高可靠性和频谱纯度而采用的优化方法及其VerilogHDL实现.
【作 者】
:
史喆
杨银堂
【机 构】
:
西安电子科技大学微电子研究所
【出 处】
:
电子设计应用
【发表日期】
:
2004年4期
【关键词】
:
寄存器
加法器
减法器
DDS
逻辑设计
优化设计
VERILOGHDL
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本文主要介绍了在DDS系统中,为了提高芯片运算速度,加大输出带宽,减小芯片规模从而提高可靠性和频谱纯度而采用的优化方法及其VerilogHDL实现.
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