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介绍一种用现场可编程门阵列FPGA实现Manchester编码器的VHDL设计方案,给出了一些重要模块的VHDL源代码。该设计方案已经用QuartusII综合通过,并适配到具体的FPGA器件APEX20KE系列,时序仿真结果与理论相吻合,时序分析表明数据传输率可达22.5 Mb/s。
Manchester编码器的FPGA设计与实现
【摘 要】
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介绍一种用现场可编程门阵列FPGA实现Manchester编码器的VHDL设计方案,给出了一些重要模块的VHDL源代码。该设计方案已经用QuartusII综合通过,并适配到具体的FPGA器件APEX20K
【机 构】
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电子科技大学
【出 处】
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电子科技大学学报
【发表日期】
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2003年03期
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