基于Verilog-HDL的RISC/DSP微处理器IP核的设计

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：yy393342067

【摘要】

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设计了一种新的既能用作通用微处理器又能用于32位定点DSP运算的RISC/DSP架构.DSP操作与ALU运算共享寄存器组,并行执行.为了提高该处理器的性能又不增加硬件复杂性,运用了可

【作者】

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陈芙蓉张向文曹梅双

【机构】

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桂林电子科技大学计算机与控制学院

【出处】

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微电子学与计算机

【发表日期】

：

2009年11期

【关键词】

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RISC DSP 微处理器有限状态机 RTL reduced instruction set computer digital signal process

【基金项目】

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国家自然科学基金项目（60804059）,广西自然科学基金项目（0640172）

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设计了一种新的既能用作通用微处理器又能用于32位定点DSP运算的RISC/DSP架构.DSP操作与ALU运算共享寄存器组,并行执行.为了提高该处理器的性能又不增加硬件复杂性,运用了可变长度的指令来提高代码密度,四级流水线提高程序执行效率,有限状态机来快速响应中断/例外.所有的模块都是基于Verilog-HDL语言,经过EDA工具的综合分析后给出了整机的RTL视图和功能仿真波形图.

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