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高速并行的RS解码器设计与FPGA实现

来源 :电子技术 | 被引量 : 23次 | 上传用户：waterkkk

【摘 要】

：

基于Berlekamp-Massey(BM)改进后的并行无逆迭代算法(iBM),将传统解码算法中制约解码频率的关键方程模块(KES)模块改进,用ROM查表法代替原有的求逆器,简化了设计,减小了时钟周期;在不影响解码品质因素的前提下,将伴随式求解模块(SC)和计算错误位置、错误值模块(CSEE )复用,形成八路并行输入输出的流水线结构,从而提高将数据率提高到原数据率的八倍,达到207.84MByte

【作 者】

：

赵明 吴泳澎 刘克刚 

【机 构】

：

中科院上海技术物理研究所,东南大学,武汉大学,

【出 处】

：

电子技术

【发表日期】

：

2007年Z3期

【关键词】

：

FPGA 并行无逆 iBM算法 查表法 模块复用 流水线 

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基于Berlekamp-Massey(BM)改进后的并行无逆迭代算法(iBM),将传统解码算法中制约解码频率的关键方程模块(KES)模块改进,用ROM查表法代替原有的求逆器,简化了设计,减小了时钟周期;在不影响解码品质因素的前提下,将伴随式求解模块(SC)和计算错误位置、错误值模块(CSEE )复用,形成八路并行输入输出的流水线结构,从而提高将数据率提高到原数据率的八倍,达到207.84MByte/S。

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