【摘 要】
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针对流水线技术构建的高速大容量存储阵列,设计了一种基于FPGA的＂无效块信息列表动态刷新算法＂。系统以NAND型Flash为存储介质,以FPGA为逻辑控制中心,在其内部建立一个一维RAM
【机 构】
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中北大学电子测试技术国家重点实验室,中北大学仪器科学与动态测试教育部重点实验室
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针对流水线技术构建的高速大容量存储阵列,设计了一种基于FPGA的＂无效块信息列表动态刷新算法＂。系统以NAND型Flash为存储介质,以FPGA为逻辑控制中心,在其内部建立一个一维RAM实现了高速大容量存储系统的无效块信息的记录。仿真结果及可行性分析验证了＂无效块信息列表动态刷新算法＂的可行性,该算法建立的无效块信息列表的容量不受存储容量扩展的影响,减少了对FPGA内部资源的占用,在满足大容量存储的同时,且不影响高速存储。
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