【摘 要】
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在对相干偏振复用四相相移键控信号进行偏振解复用的实时相干接收机中,为高效补偿偏振效应,同时降低系统对时钟频率要求与系统中FPGA资源的使用量,对接收机中广泛采用的恒模
【机 构】
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北京邮电大学信息光子学与光通信国家重点实验室
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在对相干偏振复用四相相移键控信号进行偏振解复用的实时相干接收机中,为高效补偿偏振效应,同时降低系统对时钟频率要求与系统中FPGA资源的使用量,对接收机中广泛采用的恒模算法从并行性、滤波器阶数、以及流水性3方面进行了研究改进,提出了并行流水型恒模算法.研究结果显示,在43Gb/s高速相干接收系统中,相干接收机的并行度宜为32,滤波器阶数宜为5.VPI与MATLAB联合仿真结果表明,采用本文提出的并行流水型恒模算法后,基于FPGA的四相相移键控信号实时相干接收机对时钟频率的要求可以降低到168MHz;在不丢包
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