【摘 要】
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针对高速模数转换器（ADC）对时钟信号稳定的占空比和低抖动的要求，提出了一种电荷泵型的时钟管理电路，利用电荷泵构成两个闭环回路，分别实现占空比稳定和可调双相不交叠时钟产生功
【机 构】
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西安交通大学微电子学院; 中国电子科技集团公司第五十八研究所;
【基金项目】
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国家自然科学基金资助项目（61974118）;模拟集成电路重点实验室基金资助项目（6142802180105）
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针对高速模数转换器（ADC）对时钟信号稳定的占空比和低抖动的要求，提出了一种电荷泵型的时钟管理电路，利用电荷泵构成两个闭环回路，分别实现占空比稳定和可调双相不交叠时钟产生功能。电荷泵对时钟相位的积分功能可实现宽范围的时钟占空比调节，并能明显抑制电源噪声对时钟下降沿抖动的影响。时钟管理电路采用0.18μm标准CMOS工艺设计，版图寄生参数提取后的仿真结果表明，文中时钟管理电路可在40～200MHz频率范围内，将20%～80%的输入占空比稳定地调整到45%～55%的范围内。在200mV电源干扰的条件下，文中时钟电路的输出时钟抖动可降低到传统RC型占空比稳定电路的1/10之下。所提出的时钟电路应用于一款双通道，200MSPS、14位的流水线ADC中，测试结果表明ADC的信号噪声失真比（SNDR）达到73.01dB。
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