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期刊论文
基于CPLD的通用PCI扩展总线桥设计
基于CPLD的通用PCI扩展总线桥设计
来源 :世界电子元器件 | 被引量 : 0次 | 上传用户:wrmfw315
【摘 要】
:
本文阐述了使用CPLD实现通用PCI扩展总线桥的设计方法,并且介绍了用Verilog HDL语言进行PCI总线目标模块设计的方案,重点叙述了PCI扩展总线桥逻辑设计和Verilog HDL实现模块
【作 者】
:
汪安东
【机 构】
:
西安电子科技大学电子工程学院
【出 处】
:
世界电子元器件
【发表日期】
:
2004年5期
【关键词】
:
CPLD
PCI总线
VERILOGHDL
扩展总线桥
时序状态机
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本文阐述了使用CPLD实现通用PCI扩展总线桥的设计方法,并且介绍了用Verilog HDL语言进行PCI总线目标模块设计的方案,重点叙述了PCI扩展总线桥逻辑设计和Verilog HDL实现模块的设计,最后给出了PCI扩展总线桥的仿真时序图.
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