一种低相位噪声锁相环频率合成器的设计

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通过MATLAB对锁相环进行系统建模与分析,采用改进型宽摆幅低噪声电荷泵结构,结合2位开关电容阵列技术与RC低通滤波技术,设计了一种低相位噪声锁相环频率合成器。基于SMIC 0.18μm CMOS工艺设计的芯片测试结果表明,该锁相环系统的频率覆盖范围达到1.27~1.82GHz;在中心频率为1.56GHz处的相位噪声为-105.13dBc/Hz@1 MHz,抖动(均方根)为2.2ps。 By MATLAB, the phase-locked loop is modeled and analyzed systematically. By adopting the improved wide-swing low-noise charge pump structure and the combination of 2-bit switched capacitor array and RC low-pass filter, a low phase-noise PLL Synthesizer. The chip test results based on the SMIC 0.18μm CMOS process design show that the phase-locked loop system has a frequency coverage of 1.27-1.82GHz, a phase noise of -105.13dBc / Hz@1MHz at a center frequency of 1.56GHz, Root mean square) is 2.2ps.
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