【摘 要】
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针对光幕靶在测量弹丸速度过程中出现的噪声干扰等问题,首次将凯泽窗与现场可编程门阵列FPGA相结合,设计了有限单位脉冲响应(FIR)的低通数字滤波器。为节省FPGA资源空间以提
【基金项目】
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吉林省科技厅项目(20130206013GX)
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针对光幕靶在测量弹丸速度过程中出现的噪声干扰等问题,首次将凯泽窗与现场可编程门阵列FPGA相结合,设计了有限单位脉冲响应(FIR)的低通数字滤波器。为节省FPGA资源空间以提升运行速度,将传统滤波器直接实现结构改进为相位对称结构。通过ModelSim仿真实验,证明了基于FPGA设计的低通FIR数字滤波器,在幕中触发的方式下,能够有效滤除弹丸测速过程中的随机干扰。同时,通过FPGA对噪声的有效滤波,解决了弹丸测速过程中的误触发问题。
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