【摘 要】
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本文研究了用32×8乘法器完成32×32乘法累加器的算法实现。将32×8乘法器计算出的结果作为下一次32×8乘法计算的部分积来完成4次32×8乘法结果的累加操作,减小了硬件开销。
【机 构】
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北京大学微电子所,中科院微电子中心 北京100871,北京100029
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本文研究了用32×8乘法器完成32×32乘法累加器的算法实现。将32×8乘法器计算出的结果作为下一次32×8乘法计算的部分积来完成4次32×8乘法结果的累加操作,减小了硬件开销。同时为满足累加操作的需要,对Booth算法的补偿常数的数值也做了修正。
This paper studies the implementation of a 32 × 32 multiplication accumulator with a 32 × 8 multiplier. The result of the 32 × 8 multiplier is used as the partial product of the next 32 × 8 multiplication to complete the accumulation of four 32 × 8 multiplication results, reducing the hardware overhead. At the same time, to satisfy the need of accumulative operation, the value of compensation constant of Booth algorithm is also corrected.
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