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为提高传统PSTN电话系统的兼容性及适应性,1号信令系统中的记发器信令部分需要改进硬件电路板相应设计架构,并且针对硬件电路重新设计软件架构.该文针对多路记发器信令接续的需要,设计基于DSP＋ARM＋FPGA的强大性能硬件架构,并提出记发器信令底层部分的软件设计思路及解决方法.
记发器信令系统软硬件架构设计改进
【摘 要】
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为提高传统PSTN电话系统的兼容性及适应性,1号信令系统中的记发器信令部分需要改进硬件电路板相应设计架构,并且针对硬件电路重新设计软件架构.该文针对多路记发器信令接续的
【机 构】
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重庆工商职业学院
【出 处】
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科技资讯
【发表日期】
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2015年12期
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